摘要：本申請公開的一種基于FPGA的運(yùn)算電路、示波器和測量儀器，輸出互聯(lián)矩陣模塊，將第一運(yùn)算模塊輸出的運(yùn)算結(jié)果作為第二運(yùn)算模塊的輸入量，將第三運(yùn)算模塊輸出的運(yùn)算結(jié)果作為最終輸出，第一運(yùn)算模塊為輸出的運(yùn)算結(jié)果作為其它運(yùn)算模塊輸入量的運(yùn)算模塊，第二運(yùn)算模塊為輸入量是其它運(yùn)算模塊輸出運(yùn)算結(jié)果的運(yùn)算模塊，第三運(yùn)算模塊為輸出運(yùn)算結(jié)果作為最終運(yùn)算輸出的運(yùn)算模塊，同一個(gè)運(yùn)算模塊，在不同的運(yùn)算過程中可以是第一運(yùn)算模塊、第二運(yùn)算模塊或第三運(yùn)算模塊，保障各個(gè)運(yùn)算模塊之間的多級任意互聯(lián)，使得數(shù)學(xué)運(yùn)算的拆分次數(shù)變少，進(jìn)而，提高了數(shù)學(xué)運(yùn)算速度，并且，F(xiàn)PGA的并行特性，運(yùn)算時(shí)對系統(tǒng)的其它操作不會(huì)產(chǎn)生影響，進(jìn)而不會(huì)出現(xiàn)系統(tǒng)卡頓的情況。
- 專利類型發(fā)明專利
- 申請人廣州致遠(yuǎn)電子股份有限公司;
- 發(fā)明人周立功;
- 地址510000 廣東省廣州市天河區(qū)高普路1035號第2層204房
- 申請?zhí)?/b>CN201610264757.0
- 申請時(shí)間2016年04月26日
- 申請公布號CN105892988A
- 申請公布時(shí)間2016年08月24日
- 分類號G06F7/57(2006.01)I;G01R13/02(2006.01)I;
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京公網(wǎng)安備11010802043465號
