摘要：本發(fā)明公開(kāi)了一種用于腦電檢測(cè)的數(shù)據(jù)匯集電路，包括，主時(shí)鐘、時(shí)序邏輯電路、匯集總線、鎖存/串行移位寄存器和若干個(gè)緩沖門(mén)；每條分路分別將采樣的同步數(shù)據(jù)送到一個(gè)緩沖門(mén)；所述時(shí)序邏輯電路基于所述主時(shí)鐘，按照幀結(jié)構(gòu)的要求，在不同的時(shí)刻從不同路的門(mén)控信號(hào)線上送出門(mén)控信號(hào)，控制對(duì)應(yīng)的緩沖門(mén)打開(kāi)，將該分路的同步數(shù)據(jù)送到匯集總線上；每條分路上的同步數(shù)據(jù)被送到匯集總線后，所述時(shí)序邏輯電路都向所述鎖存/串行移位寄存器送出鎖存信號(hào)將同步數(shù)據(jù)裝入所述鎖存/串行移位寄存器中，所述鎖存/串行移位寄存器在串行時(shí)鐘的控制下將裝入的數(shù)據(jù)以串行的方式輸出形成高速數(shù)據(jù)流。本發(fā)明匯集電路滿足了腦電檢測(cè)裝置工作的需要。
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