摘要：本發(fā)明提供一種FPGA芯片間的IO信道調(diào)試方法，包括以下步驟：主控FPGA芯片和從控FPGA芯片分別向?qū)Ψ桨l(fā)送用于進(jìn)行信號(hào)采樣訓(xùn)練的第一訓(xùn)練序列；主控FPGA芯片完成信號(hào)采樣訓(xùn)練之后，向從控FPGA芯片發(fā)送第二訓(xùn)練序列；接收到第二訓(xùn)練序列的從控FPGA芯片在完成信號(hào)采樣訓(xùn)練之后，也向主控FPGA芯片發(fā)送第二訓(xùn)練序列，同時(shí)進(jìn)入正常通信模式；接收到第二訓(xùn)練序列的主控FPGA芯片也進(jìn)入正常通信模式。通過使用主從控制單元和兩種訓(xùn)練序列，將動(dòng)態(tài)相位調(diào)整方法應(yīng)用到兩端都不是固定IO信道的相位自適應(yīng)通信工作中，提高IO信道通信的穩(wěn)定性，可實(shí)現(xiàn)對(duì)時(shí)鐘頻率、PCB生產(chǎn)工藝、FPGA內(nèi)部布局布線引起眼圖區(qū)間的變化的自適應(yīng)調(diào)整。
- 專利類型發(fā)明專利
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- 發(fā)明人曲賀;
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- 申請(qǐng)?zhí)?/b>CN201310513106.7
- 申請(qǐng)時(shí)間2013年10月24日
- 申請(qǐng)公布號(hào)CN103559111B
- 申請(qǐng)公布時(shí)間2016年01月20日
- 分類號(hào)G06F11/26(2006.01)I;G06F13/16(2006.01)I;
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